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CMOS模擬集成電路版圖設計培訓


為加快西安本地微電子相關專業人才工程化培養工作,推動本地集成電路設計產業發展,促進“硬科技”人才儲備。國家集成電路設計西安產業化基地,計劃開展集成電路設計領域一系列培訓課程。現將有關培訓事項通知如下:

一、 培訓內容

CMOS模擬集成電路版圖設計和驗證的基本流程,依托Cadence Virtuoso版圖設計工具、Mentor Calibre物理驗證工具和Cadence Dracula版圖驗證工具,結合實例詳細介紹了運算放大器等多類基本電路的版圖設計、驗證及后仿真的方法,以供學習CMOS模擬集成電路版圖設計與仿真

版圖設計與驗證是集成電路設計中最重要的環節,對集成電路芯片的功能和性能的實現起著決定性作用。通過本次培訓,希望可以達到讓學員了解模擬集成電路版圖設計邏輯及架構,通過本課程學習具備雙極型與CMOS型版圖設計能力,此次課程培訓大綱如下:

理論學時(32個學時)

1、器件物理   

2、雙極(Bipolar)工藝

3、CMOS工藝   

4、電阻設計

5、電容和電感設計  

6、雙極型晶體管的應用

7、MOS晶體管的應用  

8、專題設計

工程實訓學時(32個學時)

1、chiplogic提圖軟件培訓   

2、Dracula設計規則編寫培訓  

3、Calibre設計規則編寫培訓    

4、基于Cadence virtuso雙極版圖設計實訓

5、基于Cadence virtuso CMOS版圖設計實訓  

、培訓方式

每班限15人,滿10人開班。

課程內容按照雙極型與CMOS型版圖設計項目進行,包括理論學習、實訓以和上機練習,所有參加培訓學員贈送課程教材

結業標準:完成其中一個項目版圖設計包括DRC/LVS驗證。成績合格學員,頒發產業化基地培訓證書,如有需要可提供企業面試機會。

三、培訓對象

各高校電子科學/電子工程/通訊/微電子類相關專業學生 (本/碩)畢業三年內學生,企業在職人員等。

學員需具備基本計算機文化基礎,熟悉計算機基本操作使用和linux系統下的基本命令操作并了解電子元器件知識,熟悉電阻、電容、電感特性,熟悉DIODENPNPNPNMOS PMOS器件工作特性及其結構。

四、培訓地點、時間及安排

開班時間:7月28日

培訓地點:西安軟件園秦風閣B107室。

培訓時間為周末(每班限15人,滿10人開班,培訓期間每周內安排免費上機時間,不含在課時內)。

本次課程未達到考試要求,可以免費再學一次。

五、收費標準

本次培訓費用為2000/人,應屆大學生或在校學生持畢業證或學生證可享受800元/人的價格,西安本地企業在職員工為1500/人。(名額有限 欲報從速)

六、報名方式:

報名信息格式:姓名+ 大學/公司+聯系方式,接受電話微信或郵件方式報名

報名聯系人:

    曹洋  18091381063(微信)  郵箱:[email protected]




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